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【2h】

Efficient VLSI architectures for multiuser channel estimation in wireless base-station receivers

机译：无线基站接收机中用于多用户信道估计的高效VLSI架构

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作者
Rajagopal, Sridhar; Bhashyam, Srikrishna; Cavallaro, Joseph R.; Aazhang, Behnaam;
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作者单位

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年度 2001
总页数
原文格式 PDF
正文语种 eng
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1. Efficient VLSI Architectures for Multiuser Channel Estimation in wireless Base-Station Receivers [J] . Sridhar Rajagopal, Srikrishna Bhashyam, Joseph R. Cavallaro Journal of VLSI signal processing . 2002,第2期

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2. Real-time algorithms and architectures for multiuser channelestimation and detection in wireless base-station receivers [J] . Rajagopal S., Bhashyam S., Cavallaro J.R., IEEE transactions on wireless communications . 2002,第3期

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3. An Efficient Architecture for Sequential Monte Carlo Receivers in Wireless Flat-Fading Channels [J] . Mahdi Shabany Journal of signal processing systems for signal, image, and video technology . 2012,第3期

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4. Efficient VLSI architectures for baseband signal processing in wireless base-station receivers [C] . Rajagopal, S., Bhashyam, . 2000

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5. Wireless multiuser communication systems: Diversity receiver performance analysis, GSMuD design, and fading channel simulator [D] . Zhang, Dongbo 2007

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6. An Efficient VLSI Architecture for Multi-Channel Spike Sorting Using a Generalized Hebbian Algorithm [O] . Ying-Lun Chen, Wen-Jyi Hwang, Chi-En Ke 2015

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7. Real-Time Algorithms and Architectures for Multiuser Channel Estimation and Detection in Wireless Base-Station Receivers [O] . Rajagopal Sridhar, Bhashyam Srikrishna, Cavallaro Joseph R., 2003

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